使用Veloce完局部系統級協議檢查和覆蓋率收斂

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上傳日期: 2018-03-05

上 傳 者: 程林他上傳的所有資料

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標籤:Veloce(8)

  大多數(如果不是全部的話)系統級芯片(SoC)都是使用佔比越來越大的IP搭建的,這些IP來自不同的供應商,而這些供應商又限制遊覽他們的IP內部詳細信息,因此使得SoC調試起來極為困難。低功耗劃分則提出了額外的驗證挑戰。當前系統設計的複雜性要求新的基於模擬的方法才能實現比以往快得多的完整驗證,並避免代價高昂的設計反覆。典型的驗證流程缺少足夠的速度和能力去執行系統級驗證,部分原因是模擬器和主機工作站之間的傳輸瓶頸。重要的是,它們還缺少藉助其它成果的機制,比如用模擬(在芯片級和系統級)中的仿真和形式工具(在模塊和子模塊級)完成的斷言和覆蓋率結果。因此,在不同設計層次使用的各種驗證套件之間存在大量冗餘,缺少共享數據使系統集成人員專注於未經測試的功能。所有這些都使得人們很難發現覆蓋率漏洞,並阻礙快速的出帶。

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